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Modeling, Synthesis, and Rapid Prototyping with the Verilog HDL

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도서 상세정보
자료유형 :	단행본
ISBN :	0139773983
분류기호 :	TK7885.7
개인저자 :	Ciletti,Michael D
서명/저자사항 :	Modeling, Synthesis, and Rapid Prototyping with the Verilog HDL/ Ciletti,Michael D.
발행사항 :	Upper Saddle River: Prentice Hall, 1999.
형태사항 :	xxii,727p.; 25cm+ 2 CD-ROM.
언어	영어

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국방대학교 도서관

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1. Introduction to Electronic Design Automation
2. Hardware Modeling with the Verilog HDL
3. Event-Driven Simulation and Testbenches
4. Logic System, Data Types, and Operators for Modeling Verilog HDL
5. User-Defined Primitives
6. Verilog Models of Propagation Delay
7. Behavioral Descriptions in Verilog HDL
8. Synthesis of Combinational Logic
9. Synthesis of Sequential Logic
10. Synthesis of Language Constructs
11. Switch-level Models in Verilog
12. Design Examples in Verilog
13. Rapid Prototyping with Xilinx FPGAs

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